87. 实验：RISC-V微架构
2023年2月6日 1314观看
计算机组成与CPU设计实验
大学课程 / 计算机
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1实验：微程序控制07:40- 2实验：微程序控制09:20
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- 38Verilog：组合逻辑电路描述（上） - 105:35
- 39Verilog：组合逻辑电路描述（上） - 305:40
- 40Verilog：组合逻辑电路描述 - 104:20
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- 44实验：三态门和多路器09:56
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- 50实验：七段译码器03:12
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- 56实验：寄存器组（堆）03:25
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- 60实验：流水灯和移位寄存器07:18
- 61Verilog：时序逻辑电路描述（下） - 105:30
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- 63实验：计数器与分频器05:43
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- 67Verilog：有限状态机05:32
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- 70实验：加减运算电路 - 105:11
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- 72实验：加减运算电路06:57
- 73实验：加减运算电路 - 106:39
- 74实验：加减运算电路 - 306:42
- 75实验：算术逻辑单元04:31
- 76实验：数据通路 - 106:37
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- 78实验：存储器 - 106:38
- 79实验：存储器 - 306:39
- 80实验：存储器05:33
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- 82RISC-V指令系统08:23
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- 86实验：RISC-V微架构06:31
- 87实验：RISC-V微架构08:41
- 88起点：只有一条addi指令的RISC-V - 105:40
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