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86. 实验:RISC-V微架构
2023年2月6日 1248观看
计算机组成与CPU设计实验
大学课程 / 计算机
共90集
9.6万人观看
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实验:微程序控制
07:40
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实验:微程序控制
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实验:微程序控制 - 1
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实验:微程序控制 - 3
06:03
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实验:微程序控制
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课程介绍
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硬件描述语言概述 - 1
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硬件描述语言概述 - 3
05:03
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硬件描述语言概述 - 1
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硬件描述语言概述 - 3
05:45
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硬件描述语言概述
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实验:FPGA设计流程
07:03
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Quartus入门视频
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Quartus入门视频
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Quartus入门视频
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Quartus入门视频
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实验:FPGA验证流程
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实验:FPGA验证流程 - 1
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实验:FPGA验证流程 - 3
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实验:FPGA验证流程
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远程实验平台教程
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远程实验平台教程
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远程实验平台教程
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远程实验平台教程
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远程实验平台教程
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Verilog:组合逻辑电路描述(上) - 1
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Verilog:组合逻辑电路描述(上) - 3
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Verilog:组合逻辑电路描述 - 1
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Verilog:组合逻辑电路描述(上) - 1
05:05
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Verilog:组合逻辑电路描述(上) - 3
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Verilog:组合逻辑电路描述 - 1
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实验:三态门和多路器
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实验:三态门和多路器
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Verilog:组合逻辑电路描述 - 3
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Verilog:组合逻辑电路描述(下) - 1
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Verilog:组合逻辑电路描述(下) - 3
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Verilog:组合逻辑电路描述 - 3
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实验:七段译码器
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Verilog:时序逻辑电路描述 - 1
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Verilog:时序逻辑电路描述 - 1
07:18
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Verilog:时序逻辑电路描述 - 1
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Verilog:时序逻辑电路描述 - 1
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Verilog:时序逻辑电路描述 - 1
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实验:寄存器组(堆)
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实验:寄存器组(堆)
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实验:寄存器组(堆)
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Verilog:时序逻辑电路描述 - 2
08:53
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实验:流水灯和移位寄存器
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Verilog:时序逻辑电路描述(下) - 1
05:30
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Verilog:时序逻辑电路描述(下) - 3
05:30
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实验:计数器与分频器
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Verilog:有限状态机
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Verilog:有限状态机 - 1
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Verilog:有限状态机 - 3
05:05
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Verilog:有限状态机
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Verilog:有限状态机
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实验:彩灯控制器
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实验:加减运算电路 - 1
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实验:加减运算电路 - 3
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实验:加减运算电路
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实验:加减运算电路 - 1
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实验:加减运算电路 - 3
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实验:算术逻辑单元
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实验:数据通路 - 1
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实验:数据通路 - 3
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实验:存储器 - 1
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实验:存储器 - 3
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实验:存储器
05:33
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实验:存储器
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82
RISC-V指令系统
08:23
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RISC-V指令系统 - 1
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RISC-V指令系统 - 3
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RISC-V指令系统
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86
实验:RISC-V微架构
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87
实验:RISC-V微架构
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起点:只有一条addi指令的RISC-V - 1
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起点:只有一条addi指令的RISC-V - 3
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90
起点:只有一条addi指令的RISC-V
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