四川
5月25日，上海。2026国际电路与系统研讨会（IEEE ISCAS）上，一个中国女人的发言，让在场所有的全球半导体专家屏住了呼吸。
何庭波，华为公司董事、半导体业务部总裁，站在讲台上，缓缓说出了“韬（τ）定律”。
话音刚落，全场掌声雷动。
这是全球半导体产业半个多世纪以来，第一次有一个由中国企业提出的、指导全行业发展的新原则。摩尔定律统治芯片界的时代，可能要翻篇了。
一、摩尔定律快“跑不动”了，芯片界急需新规则
要理解“韬定律”为什么这么重要，得先搞清楚一个背景：芯片行业的天花板，快撞到了。
过去五十多年，全球半导体产业一直按照一个叫“摩尔定律”的规则在发展。英特尔创始人戈登·摩尔1965年提出：集成电路上可容纳的晶体管数量，大约每18到24个月翻一番，性能翻倍，成本下降。
这条定律像一个“看不见的手”，推着全世界从大哥大到智能手机，从286电脑到AI服务器，一路狂奔。
但最近几年，这辆车快没油了。
随着制程工艺逼近物理极限。从7纳米、5纳米一路杀到2纳米、1纳米。晶体管已经小到了原子级别，再往下缩，电子都乱跑了。几何缩微这条路，基本到头了。
更要命的是，成本也不听使唤了。3纳米芯片的设计费用已经飙到几亿美元，1纳米级更是天价。摩尔定律最核心的红利——性能翻倍、成本不增——正在消失。
然而偏偏在这个时候，人工智能的算力需求像坐火箭一样往上蹿。全球半导体行业都在问同一个问题：摩尔定律失效之后，芯片该怎么走下去？
这就是华为选择此刻发布“韬定律”的原因——不是赶时髦，而是真到了行业生死存亡的时候。
二、“韬定律”到底是什么？说白了就是：用时间换空间
“韬”字的拼音首字母是τ，这也是物理学里时间常数的符号。
何庭波在演讲中给出了“韬定律”的核心公式：不再死磕“几何缩微”，而是主攻“时间缩微”。
翻译成人话就是：过去大家拼的是“把晶体管做小”，现在换个思路——把信号的传播时间压短。
你做一个芯片，从A点发指令到B点运算完，中间多多少少会有时延。时延越长，效率越低。如果能把这个时间常数τ降到最低，即便晶体管尺寸不缩小，整颗芯片的性能也能大幅提升。
怎么做到的？华为亮出了核心技术——“逻辑折叠”。
以前芯片走线都是平的，信号老老实实排队走。现在华为把电路“折叠”起来，走线长度直接砍半甚至更多，信号时延自然就降下去了。何庭波透露，基于“韬定律”，华为在过去六年的探索实践中，已经设计并量产了381款芯片。
更炸裂的是2026年秋季即将面世的麒麟芯片——它将完整采用逻辑折叠技术，由单层扩展至了双层，性能实现阶跃式提升。何庭波的原话是：“我们取得了一系列仅靠先进制程工艺难以取得的进步。”
2031年的目标已经摆出来了：基于“韬定律”的高端芯片，晶体管密度将达到1.4纳米制程的同等水平。
不靠工艺硬刚，用设计弯道超车——这招，够中国人。
三、中国第一次“写规则”，华为这次争了一口气
“韬定律”的发布，不止是技术层面的突破，更深层的意义是：
这是中国在全球半导体领域，第一次成为规则的提出者。
过去五十多年，芯片产业的游戏规则都是西方定的。摩尔定律是美国人提的，架构设计是ARM和x86的天下，指令集、总线协议全在别人手里。中国企业再牛，也只是在别人画的圈里答题。
现在，圈被打破了。
“韬定律”建立了一套完整的多层级协同优化体系，从最底层的晶体管和互连优化，到芯片层面的软硬协同，再到系统层面的互联协议重构——这是一个贯穿器件、电路、芯片到系统层面的全栈解决方案。
何庭波在演讲的最后说了一句很有分量的话：“未来一定属于开放合作。在‘韬定律’的路径下，我们期待与全球科学家、工程师和产业伙伴紧密合作。”
翻译一下就是：我们有了自己的答案，但不想关起门来自己玩。这条新赛道，中国愿意开门让大家一起跑。
从2019年被列入实体清单，到手机芯片被迫断供，再到今天站在全球顶级学术会议上发布自己的产业定律——这条路，华为走了八年。2019年，何庭波在海思内部发了一封全员信，信里写道：“所有曾经打造的备胎，一夜之间全部转正。”那时她是海思总裁，字里行间带着壮士断腕的悲壮。
六年后，当华为已经设计并量产了381款自主芯片，当新一代麒麟处理器即将搭载完全自主的“逻辑折叠”技术重新出发时，那个当初在实验室度过无数个不眠之夜的女将，已经完成了从“力挽狂澜的救火队长”到“颠覆行业范式的规则制定者”的身份转变。
好戏，还在后头。
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