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73. Verilog HDL描述方式 - 2
2023年2月3日 1390观看
北京化工大学何宾教授 EDA原理及应用
大学课程 / 电子通讯
共75集
10.3万人观看
1
数字逻辑发展史 - 1
10:37
2
数字逻辑发展史 - 3
10:35
3
Multisim spice仿真介绍和操作 - 1
10:22
4
Multisim spice仿真介绍和操作 - 2
10:25
5
Multisim spice仿真介绍和操作 - 3
10:15
6
开关系统 - 1
14:37
7
开关系统 - 3
14:41
8
半导体数字集成电路
08:12
9
基本逻辑门电路分析 - 1
13:38
10
基本逻辑门电路分析 - 2
13:46
11
基本逻辑门电路分析 - 3
13:37
12
基本逻辑门电路分析 - 1
10:09
13
基本逻辑门电路分析 - 2
10:18
15
逻辑代数理论和表达式的化简 - 1
15:37
16
逻辑代数理论和表达式的化简 - 2
15:39
17
逻辑代数理论和表达式的化简 - 3
15:35
18
毛刺产生和消除
08:27
19
数字码制表示和转换
06:31
20
组合逻辑电路 - 1
14:14
21
组合逻辑电路 - 2
14:14
22
组合逻辑电路 - 3
14:10
24
组合逻辑电路 - 2
15:03
26
组合逻辑电路 - 1
06:19
27
组合逻辑电路 - 3
06:17
28
时序逻辑电路 - 1
14:21
29
时序逻辑电路 - 2
14:23
30
时序逻辑电路 - 3
14:19
31
存储器分类及原理 - 1
13:33
32
存储器分类及原理 - 3
13:33
33
有限自动状态机 - 1
14:54
34
有限自动状态机 - 2
15:00
35
有限自动状态机 - 3
14:48
36
可编程逻辑器件发展历史 - 1
14:49
37
可编程逻辑器件发展历史 - 2
14:58
38
可编程逻辑器件发展历史 - 3
14:44
39
可编程逻辑器件工艺 - 1
05:49
40
可编程逻辑器件工艺 - 3
05:51
41
简单可编程逻辑器件结构
08:08
42
CPLD原理及结构
01:59
43
FPGA原理及结构 - 1
15:26
44
FPGA原理及结构 - 2
15:29
45
FPGA原理及结构 - 3
15:19
46
FPGA原理及结构 - 1
13:10
47
FPGA原理及结构 - 2
13:16
48
FPGA原理及结构 - 3
13:09
49
IP核基本概念 - 1
08:47
50
IP核基本概念 - 3
08:52
51
Vivado工具设计流程 - 1
07:45
52
Vivado工具设计流程 - 3
07:42
53
Vivado IP数字系统的设计与实现(一) - 1
15:23
54
Vivado IP数字系统的设计与实现(一) - 2
15:31
55
Vivado IP数字系统的设计与实现(一) - 3
15:16
56
Vivado IP数字系统的设计与实现(二)
06:58
57
Vivado集成开发环境介绍 - 1
08:29
58
Vivado集成开发环境介绍 - 3
08:33
59
~5.3 创建新工程和添加Verilog HDL设计文件 - 1
10:21
60
~5.3 创建新工程和添加Verilog HDL设计文件 - 3
10:20
61
~5.5 详细描述和行为级仿真 - 1
10:41
62
~5.5 详细描述和行为级仿真 - 3
10:42
63
~5.7 设计综合和设计约束 - 1
11:20
64
~5.7 设计综合和设计约束 - 3
11:17
65
~5.9 设计实现和时序仿真 - 1
07:14
66
~5.9 设计实现和时序仿真 - 3
07:14
67
生成比特流和下载设计 - 1
10:26
68
生成比特流和下载设计 - 3
10:27
69
Verilog HDL程序结构 - 1
12:37
70
Verilog HDL程序结构 - 2
12:44
71
Verilog HDL程序结构 - 3
12:31
72
Verilog HDL描述方式 - 1
10:33
73
Verilog HDL描述方式 - 2
10:38
74
Verilog HDL描述方式 - 3
10:34
75
Verilog HDL语言要素 - 1
12:35
76
Verilog HDL语言要素 - 3
12:41
77
Verilog HDL数据类型 - 1
12:36
78
Verilog HDL数据类型 - 3
12:38
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