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SC6302是一款兼容HMC7044的高性能双环路整数、小数分频抖动衰减器，能够执行频率转换、选择参考信号并生成超低相位噪声的时钟提供给并行或串行(JESD204B)接口的高速数据转换器。SC6302提供14路低噪声且可配置的输出，可以灵活地匹配RF收发器系统中的许多不同器件接口，比如数据转换器、本振、发送/接收模块、FPGA和数字前端(DFE)ASIC。
SC6302可产生最多7对DCLK和SYSREF，符合JESD204B接口要求。该器件具有出色的串扰、频率隔离以及杂散性能，支持单端和差分输出频率。DCLK和SYSREF时钟输出可配置为不同的输出信号标准，如CML、LVDS、LVPECL和LVCMOS。
主要性能：
•支持JEDEC JESD204B
•超低RMS抖动
48fs RMS Jitter(12kHz到20MHz)@2457.6M
底噪：-153dBc/Hz@2457.6MHz
•PLL2可提供多达14路差分时钟
最多7个SYSREF时钟
时钟最大输出频率3.2GHz
支持LVPECL，LVDS，CML等输出接口
•支持最多2个缓冲压控振荡器(VCXO)输出
•信号丢失(LOS)检测和无中断参考切换
•4 个GPIO报警/状态指示器
•支持最高3200MHz的外部VCO输入
•工作温度：-40℃到85℃
•工作电压：3.15V到3.45V
•QFN-68封装
应用场景：JESD204B时钟产生、无线基础设施（多载波GSM、LTE、W-CDMA）、数据转换器时钟、微波基带卡、相控阵参考分配
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