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35. 模块九 4.3 时钟控制触发器(1) - 1
2023年9月1日 1379观看
数字电路与系统设计
西安电子科技大学
大学课程 / 电子通讯
西安电子科技大学“数字电路与系统设计”课程2004年被评为国家级精品课程,2013年获得国家精品课程共享建设立项,并在爱课程(精品共享课程)上线。“数字电路与系统设计”2018年被评为国家级精品在线开放课程。 在爱课程(中国大学MOOC)开课以来,选课的高校来自国内外,国内大学包含了985、211和普通高校。从课程网上互动讨论的情况来看,课程受到学习者的好评,为不同的学习者提供了一个课程资源共享的学习平台。 课程的性质 “数字电路与系统设计”是电子信息、计算机技术、自动控制、工业自动化、检测技术、生物医学工程等专业本科生必修的学科基础课程。 课程的目标与任务 要求学生掌握数字电路的基本概念、基本原理和基本方法,了解电子设计自动化(EDA:Electronic Design Automation)技术和工具。数字电路部分要求学生掌握数制及编码、逻辑代数及逻辑函数的知识;掌握组合逻辑电路的分析与设计方法,熟悉常用的中规模组合逻辑部件的功能及其应用;掌握同步时序逻辑电路的分析和设计方法,典型的中大规模时序逻辑部件。掌握EDA设计工具,培养学生设计较大规模的数字电路系统的能力。注重学生学习新知识、掌握新方法、培养新技能、解决新问题。 课程内容主要包括:数字电路基础知识(数制、编码、逻辑代数、逻辑门、触发器等),组合电路分析、设计方法,时序电路分析、设计方法,脉冲波形的产生与整形、可编程逻辑器件以及模拟-数字转换等。 本课程与其它课程的联系和分工 学习该课程的先修课程有:高等数学、普通物理、电路分析基础、模拟电路。“数字电路与系统设计”在学科基础中的地位既要体现数字电子线路作为一门课程的完整性和电子线路体系结构的特点,也要体现为后续课程服务的目的。后续的专业课程如计算机组成原理,微机原理、接口技术等都是数字电路系统高度集成的体现。数字电路与系统设计为后续课程进行了基础知识准备。 教材
共92集
10万人观看
1
模块四 2.42 逻辑函数的两种标准形式 - 1
07:05
2
模块四 2.42 逻辑函数的两种标准形式 - 3
07:10
3
模块五 2.52 卡诺图的合并规律 - 1
06:51
4
模块五 2.52 卡诺图的合并规律 - 3
06:53
5
模块五 2.52 化简为最简与或式 - 1
09:40
6
模块五 2.52 化简为最简与或式 - 3
09:40
7
模块五 2.52 化简为最简或与式 - 1
05:52
8
模块五 2.52 化简为最简或与式 - 3
05:55
9
模块五 2.53 无关项逻辑函数及其化简(1)
09:59
10
模块五 2.53 无关项逻辑函数及其化简(2) - 1
06:00
11
模块五 2.53 无关项逻辑函数及其化简(2) - 3
06:00
12
模块六 3.1 组合逻辑电路的分析 - 1
05:03
13
模块六 3.1 组合逻辑电路的分析 - 3
05:07
14
模块六 3.2 组合逻辑电路的设计 - 1
07:37
15
模块六 3.2 组合逻辑电路的设计 - 3
07:35
16
模块七 3.3 译码器功能 - 1
05:17
17
模块七 3.3 译码器功能 - 3
05:15
18
模块七 3.4 译码器的应用(1) - 1
08:16
19
模块七 3.4 译码器的应用(1) - 3
08:13
20
模块七 3.4 译码器的应用(2)
04:55
21
模块八 3.5 数据选择器功能 - 1
05:45
22
模块八 3.5 数据选择器功能 - 3
05:51
23
模块八 3.6 数据选择器应用(1) - 1
05:26
24
模块八 3.6 数据选择器应用(1) - 3
05:24
25
模块八 3.6 数据选择器应用(2) - 1
08:00
26
模块八 3.6 数据选择器应用(2) - 3
08:00
27
模块八 3.7 数据选择器的扩展 - 1
05:53
28
模块八 3.7 数据选择器的扩展 - 3
05:56
29
模块九 4.1 触发器概述 - 1
09:28
30
模块九 4.1 触发器概述 - 3
09:26
31
模块九 4.2 基本RS触发器的描述方法(1) - 1
06:25
32
模块九 4.2 基本RS触发器的描述方法(1) - 3
06:30
33
模块九 4.2 基本RS触发器的描述方法(2) - 1
05:25
34
模块九 4.2 基本RS触发器的描述方法(2) - 3
05:31
35
模块九 4.3 时钟控制触发器(1) - 1
07:14
36
模块九 4.3 时钟控制触发器(1) - 3
07:18
37
模块九 4.3 时钟控制触发器(2)
09:10
38
模块十 4.4 主从和边沿触发器(1)
04:23
39
模块十 4.4 主从和边沿触发器(2)
06:37
40
模块十 4.4 主从和边沿触发器(3)
05:47
41
模块十 4.5 触发器的逻辑符号和波形(1)
05:00
42
模块十 4.5 触发器的逻辑符号和波形(2) - 1
05:38
43
模块十 4.5 触发器的逻辑符号和波形(2) - 3
05:37
44
模块十一 5.1 时序逻辑电路的分类
07:36
45
模块十一 5.2 同步时序电路的分析(1) - 1
05:59
46
模块十一 5.2 同步时序电路的分析(1) - 3
05:59
47
模块十一 5.2 同步时序电路的分析(2) - 1
05:51
48
模块十一 5.2 同步时序电路的分析(2) - 3
05:53
49
模块十一 5.3 同步时序电路的仿真分析 - 1
07:22
50
模块十一 5.3 同步时序电路的仿真分析 - 3
07:25
51
模块十一 5.4 环形计数器分析举例 - 1
07:54
52
模块十一 5.4 环形计数器分析举例 - 3
07:59
53
模块十一 5.5 环形计数器的仿真分析 - 1
08:38
54
模块十一 5.5 环形计数器的仿真分析 - 3
08:35
55
模块十一 5.6 序列码检测电路分析 - 1
06:39
56
模块十一 5.6 序列码检测电路分析 - 3
06:38
57
模块十二 5.7 同步时序电路设计(1) - 1
06:44
58
模块十二 5.7 同步时序电路设计(1) - 3
06:48
59
模块十二 5.7 同步时序电路设计(2) - 1
05:47
60
模块十二 5.7 同步时序电路设计(2) - 3
05:44
61
模块十二 5.8 可逆计数器的设计仿真 - 1
08:11
62
模块十二 5.8 可逆计数器的设计仿真 - 3
08:17
63
模块十二 5.9 建立原始状态图或状态表 - 1
10:12
64
模块十二 5.9 建立原始状态图或状态表 - 3
10:09
65
模块十二 5.10 建立原始状态图或状态表举例 - 1
11:24
66
模块十二 5.10 建立原始状态图或状态表举例 - 3
11:28
67
模块十三 5.12 状态分配 - 1
05:34
68
模块十三 5.12 状态分配 - 3
05:38
69
模块十三 5.13 同步时序逻辑电路的设计举例 - 1
07:18
70
模块十三 5.13 同步时序逻辑电路的设计举例 - 3
07:16
71
模块十四 5.14 集成计数器 - 1
08:27
72
模块十四 5.14 集成计数器 - 3
08:24
73
模块十四 5.15 集成计数器级联 - 1
07:40
74
模块十四 5.15 集成计数器级联 - 3
07:41
75
模块十四 5.16 异步清零法实现任意模值计数器 - 1
07:37
76
模块十四 5.16 异步清零法实现任意模值计数器 - 3
07:40
77
模块十五 5.17 同步置数法实现任意模值计数器 - 1
06:44
78
模块十五 5.17 同步置数法实现任意模值计数器 - 3
06:49
79
模块十五 5.18 可编程任意模值计数器 - 1
12:20
80
模块十五 5.18 可编程任意模值计数器 - 3
12:20
81
模块十五 5.19 分频器 - 1
06:57
82
模块十五 5.19 分频器 - 3
06:55
83
模块十六 5.20 集成寄存器 - 1
12:21
84
模块十六 5.20 集成寄存器 - 3
12:22
85
模块十六 5.21 集成移位寄存器构成环形计数器 - 1
09:30
86
模块十六 5.21 集成移位寄存器构成环形计数器 - 3
09:31
87
模块十六 5.22 扭环计数器 - 1
10:58
88
模块十六 5.22 扭环计数器 - 3
10:57
89
模块十七 5.23 序列信号检测器 - 1
06:41
90
模块十七 5.23 序列信号检测器 - 3
06:49
91
模块十七 5.24 序列信号发生器 - 1
10:54
92
模块十七 5.24 序列信号发生器 - 3
11:01
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