197. 模块十一 7.3 序列信号发生器（4） - 3

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数字电路与系统

大学课程 / 电子通讯

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1模块一课程介绍 - 1
08:57
2模块一课程介绍 - 3
08:56
3模块一概述（1）
05:45
4模块一概述（2） - 1
10:11
5模块一概述（2） - 3
10:09
6模块一概述（3）
07:10
7模块一概述（4）
04:18
8模块一概述（5） - 1
08:12
9模块一概述（5） - 3
08:13
10模块一概述（6）
06:47
11模块二 1.1 数制与数制之间的转换（1） - 1
09:06
12模块二 1.1 数制与数制之间的转换（1） - 3
09:05
13模块二 1.1 数制与数制之间的转换（2） - 1
07:42
14模块二 1.1 数制与数制之间的转换（2） - 3
07:43
15模块二 1.1 数制与数制之间的转换（3） - 1
08:01
16模块二 1.1 数制与数制之间的转换（3） - 3
08:00
17模块二 1.1 数制与数制之间的转换（4） - 1
09:50
18模块二 1.1 数制与数制之间的转换（4） - 3
09:51
19模块二 1.2 码制和计算机的数的表示方法（1） - 1
09:07
20模块二 1.2 码制和计算机的数的表示方法（1） - 3
09:07
21模块二 1.2 码制和计算机的数的表示方法（2）
07:58
22模块二 1.2 码制和计算机的数的表示方法（3） - 1
06:55
23模块二 1.2 码制和计算机的数的表示方法（3） - 3
06:53
24模块二 1.2 码制和计算机的数的表示方法（4） - 1
09:01
25模块二 1.2 码制和计算机的数的表示方法（4） - 3
09:06
26模块二 1.2 码制和计算机的数的表示方法（5）
06:28
27模块二 1.3 计算机中的非数值数据（1）
07:06
28模块二 1.3 计算机中的非数值数据（2） - 1
06:27
29模块二 1.3 计算机中的非数值数据（2） - 3
06:27
30模块二 1.3 计算机中的非数值数据（3）
08:46
31模块三 2.1 逻辑函数基本运算与定律（1） - 1
12:29
32模块三 2.1 逻辑函数基本运算与定律（1） - 3
12:28
33模块三 2.1 逻辑函数基本运算与定律（2） - 1
06:43
34模块三 2.1 逻辑函数基本运算与定律（2） - 3
06:47
35模块三 2.1 逻辑函数基本运算与定律（3）
05:02
36模块三 2.1 逻辑函数基本运算与定律（4）
06:34
37模块三 2.1 逻辑函数基本运算与定律（5） - 1
05:35
38模块三 2.1 逻辑函数基本运算与定律（5） - 3
05:39
39模块三 2.1 逻辑函数基本运算与定律（6）
07:18
40模块三 2.2 逻辑函数及其描述方法（1）
04:22
41模块三 2.2 逻辑函数及其描述方法（2）
06:11
42模块三 2.2 逻辑函数及其描述方法（3）
05:46
43模块三 2.2 逻辑函数及其描述方法（4） - 1
10:37
44模块三 2.2 逻辑函数及其描述方法（4） - 3
10:42
45模块三 2.2 逻辑函数及其描述方法（5） - 1
09:48
46模块三 2.2 逻辑函数及其描述方法（5） - 3
09:51
47模块三 2.3 逻辑函数的化简（1） - 1
06:33
48模块三 2.3 逻辑函数的化简（1） - 3
06:37
49模块三 2.3 逻辑函数的化简（2） - 1
06:19
50模块三 2.3 逻辑函数的化简（2） - 3
06:23
51模块三 2.3 逻辑函数的化简（3） - 1
08:51
52模块三 2.3 逻辑函数的化简（3） - 3
08:51
53模块三 2.3 逻辑函数的化简（4） - 1
10:00
54模块三 2.3 逻辑函数的化简（4） - 3
10:05
55模块四 3.1 组合逻辑电路的分析与最少化设计（1） - 1
09:58
56模块四 3.1 组合逻辑电路的分析与最少化设计（1） - 3
09:55
57模块四 3.1 组合逻辑电路的分析与最少化设计（2）
09:56
58模块四 3.1 组合逻辑电路的分析与最少化设计（3） - 1
09:15
59模块四 3.1 组合逻辑电路的分析与最少化设计（3） - 3
09:17
60模块四 3.1 组合逻辑电路的分析与最少化设计（4）
08:01
61模块四 3.2 组合逻辑电路的竞争与冒险（1） - 1
09:19
62模块四 3.2 组合逻辑电路的竞争与冒险（1） - 3
09:23
63模块四 3.2 组合逻辑电路的竞争与冒险（2） - 1
08:58
64模块四 3.2 组合逻辑电路的竞争与冒险（2） - 3
09:00
65模块四 3.2 组合逻辑电路的竞争与冒险（3） - 1
07:17
66模块四 3.2 组合逻辑电路的竞争与冒险（3） - 3
07:21
67模块四 3.2 组合逻辑电路的竞争与冒险（4） - 1
11:20
68模块四 3.2 组合逻辑电路的竞争与冒险（4） - 3
11:26
69模块四 3.2 组合逻辑电路的竞争与冒险（5）
07:50
70模块四实验教学（一）（1）
01:08
71模块四实验教学（一）（2）
01:58
72模块四实验教学（一）（3）
02:24
73模块四实验教学（一）（4）
02:05
74模块五 4.1 编码器译码器（1） - 1
07:43
75模块五 4.1 编码器译码器（1） - 3
07:41
76模块五 4.1 编码器译码器（2） - 1
05:57
77模块五 4.1 编码器译码器（2） - 3
06:02
78模块五 4.1 编码器译码器（3） - 1
12:30
79模块五 4.1 编码器译码器（3） - 3
12:31
80模块五 4.1 编码器译码器（4） - 1
07:30
81模块五 4.1 编码器译码器（4） - 3
07:29
82模块五 4.1 编码器译码器（5） - 1
05:54
83模块五 4.1 编码器译码器（5） - 3
05:58
84模块五 4.1 编码器译码器（6）
09:50
85模块五 4.1 编码器译码器（7） - 1
09:08
86模块五 4.1 编码器译码器（7） - 3
09:14
87模块五 4.2 数据选择器分配器（1） - 1
07:59
88模块五 4.2 数据选择器分配器（1） - 3
08:02
89模块五 4.2 数据选择器分配器（2） - 1
05:10
90模块五 4.2 数据选择器分配器（2） - 3
05:07
91模块五 4.2 数据选择器分配器（3） - 1
12:23
92模块五 4.2 数据选择器分配器（3） - 3
12:28
93模块五 4.2 数据选择器分配器（4） - 1
08:21
94模块五 4.2 数据选择器分配器（4） - 3
08:18
95模块六 4.3 比较器校验电路（1） - 1
07:00
96模块六 4.3 比较器校验电路（1） - 3
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97模块六 4.3 比较器校验电路（2） - 1
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98模块六 4.3 比较器校验电路（2） - 3
07:42
99模块六 4.3 比较器校验电路（3） - 1
11:52
100模块六 4.3 比较器校验电路（3） - 3
11:49
101模块六 4.4 算术运算电路及ALU（1） - 1
06:00
102模块六 4.4 算术运算电路及ALU（1） - 3
06:02
103模块六 4.4 算术运算电路及ALU（2） - 1
05:26
104模块六 4.4 算术运算电路及ALU（2） - 3
05:31
105模块六 4.4 算术运算电路及ALU（3） - 1
09:57
106模块六 4.4 算术运算电路及ALU（3） - 3
09:55
107模块六 4.4 算术运算电路及ALU（4） - 1
08:08
108模块六 4.4 算术运算电路及ALU（4） - 3
08:12
109模块六 4.4 算术运算电路及ALU（5） - 1
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110模块六 4.4 算术运算电路及ALU（5） - 3
12:04
111模块六 4.4 算术运算电路及ALU（6）
03:54
112模块六关键知识点讲解（一）（1）
07:20
113模块六关键知识点讲解（一）（2）
06:33
114模块六关键知识点讲解（一）（3）
06:39
115模块六关键知识点讲解（一）（4）
03:43
116模块六关键知识点讲解（一）（5）
05:06
117模块六关键知识点讲解（一）（6）
04:40
118模块六关键知识点讲解（一）（7）
06:30
119模块六关键知识点讲解（一）（8）
09:38
120模块六关键知识点讲解（一）（9）
06:28
121模块六关键知识点讲解（一）（10） - 1
06:49
122模块六关键知识点讲解（一）（10） - 3
06:47
123模块七触发器（1） - 1
10:00
124模块七触发器（1） - 3
10:06
125模块七触发器（2） - 1
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126模块七触发器（2） - 3
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127模块七触发器（3） - 1
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128模块七触发器（3） - 3
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129模块七触发器（4）
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130模块七触发器（5） - 1
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131模块七触发器（5） - 3
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132模块七触发器（6）
07:16
133模块七触发器（7） - 1
10:00
134模块七触发器（7） - 3
09:57
135模块七触发器（8） - 1
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137模块七触发器（9） - 1
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139模块七触发器（10）
04:25
140模块七触发器（11） - 1
07:44
141模块七触发器（11） - 3
07:46
142模块七触发器（12）
09:59
143模块七触发器（13）
09:55
144模块八 6.1 时序逻辑电路分析（1） - 1
06:29
145模块八 6.1 时序逻辑电路分析（1） - 3
06:30
146模块八 6.1 时序逻辑电路分析（2） - 1
11:04
147模块八 6.1 时序逻辑电路分析（2） - 3
11:07
148模块八 6.1 时序逻辑电路分析（3） - 1
09:46
149模块八 6.1 时序逻辑电路分析（3） - 3
09:43
150模块八 6.1 时序逻辑电路分析（4） - 1
07:50
151模块八 6.1 时序逻辑电路分析（4） - 3
07:47
152模块八 6.1 时序逻辑电路分析（5） - 1
11:38
153模块八 6.1 时序逻辑电路分析（5） - 3
11:43
154模块八 6.1 时序逻辑电路分析（6） - 1
12:06
155模块八 6.1 时序逻辑电路分析（6） - 3
12:13
156模块九 6.2 时序逻辑电路设计（1） - 1
10:47
157模块九 6.2 时序逻辑电路设计（1） - 3
10:47
158模块九 6.2 时序逻辑电路设计（2） - 1
08:26
159模块九 6.2 时序逻辑电路设计（2） - 3
08:31
160模块九 6.2 时序逻辑电路设计（3） - 1
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161模块九 6.2 时序逻辑电路设计（3） - 3
08:36
162模块九 6.2 时序逻辑电路设计（4）
02:44
163模块九 6.2 时序逻辑电路设计（5） - 1
08:45
164模块九 6.2 时序逻辑电路设计（5） - 3
08:48
165模块九 6.2 时序逻辑电路设计（6） - 1
07:43
166模块九 6.2 时序逻辑电路设计（6） - 3
07:49
167模块九 6.2 时序逻辑电路设计（7）
07:33
168模块十 7.1 寄存器和移位寄存器（1） - 1
06:40
169模块十 7.1 寄存器和移位寄存器（1） - 3
06:41
170模块十 7.1 寄存器和移位寄存器（2） - 1
10:47
171模块十 7.1 寄存器和移位寄存器（2） - 3
10:52
172模块十 7.1 寄存器和移位寄存器（3）
02:20
173模块十 7.1 寄存器和移位寄存器（4） - 1
11:24
174模块十 7.1 寄存器和移位寄存器（4） - 3
11:30
175模块十 7.2 计数器（1） - 1
07:41
176模块十 7.2 计数器（1） - 3
07:38
177模块十 7.2 计数器（2） - 1
08:35
178模块十 7.2 计数器（2） - 3
08:40
179模块十 7.2 计数器（3） - 1
09:19
180模块十 7.2 计数器（3） - 3
09:18
181模块十 7.2 计数器（4）
06:43
182模块十 7.2 计数器（5） - 1
05:12
183模块十 7.2 计数器（5） - 3
05:14
184模块十 7.2 计数器（6） - 1
11:10
185模块十 7.2 计数器（6） - 3
11:13
186模块十 7.2 计数器（7） - 1
11:53
187模块十 7.2 计数器（7） - 3
11:53
188模块十 7.2 计数器（8）
05:54
189模块十 7.2 计数器（9） - 1
05:07
190模块十 7.2 计数器（9） - 3
05:13
191模块十一 7.3 序列信号发生器（1）
05:12
192模块十一 7.3 序列信号发生器（2） - 1
11:57
193模块十一 7.3 序列信号发生器（2） - 3
12:01
194模块十一 7.3 序列信号发生器（3） - 1
09:11
195模块十一 7.3 序列信号发生器（3） - 3
09:09
196模块十一 7.3 序列信号发生器（4） - 1
05:12
197模块十一 7.3 序列信号发生器（4） - 3
05:10
198模块十二 8.1 半导体存储器概念（1） - 1
12:15
199模块十二 8.1 半导体存储器概念（1） - 3
12:17
200模块十二 8.1 半导体存储器概念（2） - 1
13:00
201模块十二 8.1 半导体存储器概念（2） - 3
13:07
202模块十二 8.1 半导体存储器概念（3）
04:43
203模块十二 8.2 随机存储器RAM（1） - 1
06:37
204模块十二 8.2 随机存储器RAM（1） - 3
06:34
205模块十二 8.2 随机存储器RAM（2） - 1
06:26
206模块十二 8.2 随机存储器RAM（2） - 3
06:32
207模块十二 8.2 随机存储器RAM（3） - 1
06:47
208模块十二 8.2 随机存储器RAM（3） - 3
06:49
209模块十二 8.2 随机存储器RAM（4） - 1
09:41
210模块十二 8.2 随机存储器RAM（4） - 3
09:43
211模块十二 8.2 随机存储器RAM（5） - 1
05:47
212模块十二 8.2 随机存储器RAM（5） - 3
05:49
213模块十二 8.3 只读存储器ROM - 1
10:13
214模块十二 8.3 只读存储器ROM - 3
10:10
215模块十二 8.4 存储器容量的扩展（1） - 1
06:36
216模块十二 8.4 存储器容量的扩展（1） - 3
06:38
217模块十二 8.4 存储器容量的扩展（2）
05:35
218模块十二 8.4 存储器容量的扩展（3） - 1
08:30
219模块十二 8.4 存储器容量的扩展（3） - 3
08:34
220模块十三 9.1 可编程逻辑器件的结构与表示方法 - 1
06:31
221模块十三 9.1 可编程逻辑器件的结构与表示方法 - 3
06:30
222模块十三 9.2 PLA与PAL（1）
01:50
223模块十三 9.2 PLA与PAL（2） - 1
11:12
224模块十三 9.2 PLA与PAL（2） - 3
11:19
225模块十三 9.2 PLA与PAL（3）
09:02
226模块十三 9.3 GAL - 1
05:18
227模块十三 9.3 GAL - 3
05:18
228模块十三 9.4 CPLD
05:41
229模块十三 9.5 FPGA
08:16
230模块十四 10.1 概述（1） - 1
09:30
231模块十四 10.1 概述（1） - 3
09:34
232模块十四 10.1 概述（2） - 1
06:09
233模块十四 10.1 概述（2） - 3
06:07
234模块十四 10.2 数模转换（1） - 1
06:34
235模块十四 10.2 数模转换（1） - 3
06:37
236模块十四 10.2 数模转换（2） - 1
06:40
237模块十四 10.2 数模转换（2） - 3
06:39
238模块十四 10.2 数模转换（3）
07:00
239模块十四 10.2 数模转换（4）
07:46
240模块十四 10.2 数模转换（5）
08:02
241模块十四 10.2 数模转换（6） - 1
10:45
242模块十四 10.2 数模转换（6） - 3
10:47
243模块十四 10.3 模数转换（1） - 1
10:58
244模块十四 10.3 模数转换（1） - 3
10:59
245模块十四 10.3 模数转换（2）
07:59
246模块十四 10.3 模数转换（3） - 1
11:50
247模块十四 10.3 模数转换（3） - 3
11:49
248模块十四 10.3 模数转换（4） - 1
10:10
249模块十四 10.3 模数转换（4） - 3
10:11
250模块十四 10.3 模数转换（5） - 1
09:06
251模块十四 10.3 模数转换（5） - 3
09:07
252模块十四 10.3 模数转换（6） - 1
09:25
253模块十四 10.3 模数转换（6） - 3
09:29
254模块十四 10.3 模数转换（7）
08:45
255模块十五 11.1 数字系统概念（1） - 1
06:09
256模块十五 11.1 数字系统概念（1） - 3
06:11
257模块十五 11.1 数字系统概念（2） - 1
10:58
258模块十五 11.1 数字系统概念（2） - 3
11:02
259模块十五 11.2 数字系统设计举例（1） - 1
11:44
260模块十五 11.2 数字系统设计举例（1） - 3
11:50
261模块十五 11.2 数字系统设计举例（2） - 1
10:07
262模块十五 11.2 数字系统设计举例（2） - 3
10:12
263模块十五 11.2 数字系统设计举例（3） - 1
06:03
264模块十五 11.2 数字系统设计举例（3） - 3
06:08
265模块十五 11.2 数字系统设计举例（4）
06:46
266模块十五 11.2 数字系统设计举例（5） - 1
05:22
267模块十五 11.2 数字系统设计举例（5） - 3
05:23
268模块十五 11.2 数字系统设计举例（6） - 1
05:26
269模块十五 11.2 数字系统设计举例（6） - 3
05:24

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