北京
量子计算机要真正跑起来，得先解决一个麻烦：错误。量子比特太容易被环境干扰，控制操作也不完美，错误会一点点累积，最后把计算搞垮。所以量子计算领域有个绕不开的环节——量子纠错。而纠错本身又要花时间，怎么在纠错的同时不把计算拖成蜗牛爬，是道难题。
量子计算公司 SEEQC 最近说，他们演示了一套架构，把基于专用芯片的处理和英伟达（NVIDIA）的量子计算软件、GPU 基础设施结合起来，让量子纠错解码的两项关键指标改善了大约 50%。
这套组合里，一边是 SEEQC 自己的芯片级预解码器技术，另一边是英伟达的两样东西：NVIDIA Ising，一个开放的 AI 模型家族，里面包含用于量子纠错的工具；以及 NVIDIA NVQLink，一个用来把量子处理器和 GPU 加速计算系统连起来的接口。
演示用的是模拟的量子处理器和系统架构，并且把真实规模的解码器延迟也算了进去。对比的对象是让 NVIDIA Ising 单独充当预解码器。SEEQC 报告的结果是：解码延迟降低约 50%，逻辑错误率表现也有改善。
要理解这个数字为什么值得看一眼，得先知道纠错在量子计算里到底卡在哪。
量子计算机用量子比特存信息，它和传统二进制位不一样，但同样怕干扰。量子纠错的办法，是把信息编码到多个物理量子比特上，再通过测量去发现错误——注意，不能直接测量并破坏掉被编码的量子信息。这些测量数据随后交给经典计算系统处理，判断该做哪些修正。
这个经典处理阶段就叫解码。量子处理器越大，要处理的信息量可能涨得越凶，纠错能用的时间和算力资源就被压得越紧。这里有两个关键指标：解码延迟，处理错误信息所需的时间；逻辑错误率，描述一个编码后的逻辑量子比特出错的频率。两个都降下来，容错量子计算才更有可能落地。
SEEQC 的思路，是把一部分解码活儿挪到离量子处理单元（QPU）更近的地方。具体说，用芯片级预解码器在本地先处理一部分信息，再交给 NVIDIA Ising 的解码能力，中间靠 SEEQC 的 Digital Link 和 NVIDIA NVQLink 搭一条低延迟通道，把量子和 GPU 加速计算两端连起来。
说白了就是：先在本地消化一些数据，再往上层经典计算资源送，这样在组件之间搬来搬去的量可能少一些，对时间敏感的操作也能快一些。这个区别不是文字游戏——量子计算机不是光加量子比特就能扩规模的，配套的电子设备、通信链路、经典处理系统都得跟上。把选定的处理任务往 QPU 身边挪，或许能减少系统变大时纠错所需的时间和基础设施开销。
SEEQC 首席执行官 John Levy 说，这些结果展示了数字芯片技术如何改善量子处理器和高性能计算基础设施之间的接口。英伟达量子产品总监 Sam Stanwyck 说，这项工作表明开放的模型和接口能帮量子硬件开发者把专用处理和 AI、GPU 计算结合起来。
不过这个 50% 得放在上下文里看。实验用的是模拟的量子处理器和架构栈，并不是在一台完全运行的真实物理量子计算机上跑出同样的性能提升。这次公布也没有确立一件事：这个改善会直接换算成建造容错系统所需总资源减少 50%。它能提供的证据是，把解码任务分散到专用芯片处理和 GPU 加速计算之间，可能改善纠错流水线里的关键环节。
SEEQC 说下一步是把目前演示的系统级组件整合起来，朝着量子处理器与先进高性能计算基础设施的芯片对芯片集成推进，同时继续找机会改进量子纠错和其他量子—经典混合工作负载。
说到底，实用的容错量子计算要靠整个系统一起进步：量子比特、控制电子、通信、解码，哪一环都不能掉队。这次的演示碰的是其中一环，指向的问题是——硬件和软件贴得更紧，量子系统扩规模时会不会更省力一点。答案还没到揭晓的时候，但至少有人把这条路上的一个路标立起来了。
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